高速以太網(wǎng)串并-并串轉換電路.pdf_第1頁
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文檔簡介

1、該論文介紹了一種CMOS工藝單片集成的千兆以太網(wǎng)串并-并串轉換電路.芯片中采用了一個模擬鎖相環(huán)產(chǎn)生1.25GHz的高速時鐘,同時由一個10到1的時分多路選擇器完成并行數(shù)據(jù)到串行數(shù)據(jù)的轉換.在接收端,高速的差分輸入信號首先經(jīng)過均衡電路均衡放大,再通過雙端變單端轉換電路轉換成0-Vdd的數(shù)字信號.一個由頻率鎖相環(huán)輔助捕獲的鎖相環(huán)時鐘提取電路從接收數(shù)據(jù)中提取時鐘,并將數(shù)據(jù)重新同步.串行到并行的轉換和字節(jié)同步電路也包含在芯片中.該芯片單片集成了

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