鎖存器-眾賞文庫

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鎖存器的作用（32頁）

鎖存器的作用鎖存器的作用在LED和數(shù)碼管顯示方面，要維持一個數(shù)據(jù)的顯示，往往要持續(xù)的快速的刷新。尤其是在四段八位數(shù)碼管等這些要選通的顯示設備上。在人類能夠接受的刷新頻率之內，大概每三十毫秒就要刷新一次。這就大大占用了處理器的處理時間，消耗了處理器的處...

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《金鎖玉關面授精要》（11頁）

禪道網出品第1頁共11頁禪道網電話01081882938金鎖玉關面授精要金鎖玉關面授精要一、面授經驗集錦1。有很大地勢的大建築，或大山大川，就叫有氣勢。我們取好地，大貴地時，一定要選氣勢大，氣魄大的大地，才有大作為，作出大事，出大貴人。才能氣運長久，代代興旺。2...

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74ls74 鎖存器（16頁）

第三部分第三部分時序邏輯電路時序邏輯電路導讀如果電路在某一時刻的輸出狀態(tài)不僅取決于電路在這一時刻的輸入狀態(tài)，而且與電路過去的狀態(tài)有關，也就是說電路具有了記憶功能，這種電路就叫做時序邏輯電路。時序邏輯電路中能夠完成記憶功能的電路叫做觸發(fā)器，它是最重...

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碩士學位論文碩士學位論文（工程碩士）鎖存器加固設計與應用DESIGNAPPLICATIONOFRADIATIONHARDENEDLATCHES張釗張釗哈爾濱工業(yè)大學哈爾濱工業(yè)大學2011年6月CLASSIFIEDINDEXTN432UDC6213049774DISSERTATIONFTHEMASTER’SDEGREEINENGINEERINGDESIGNAPPLICATIONOFRADIATI...

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鎖存器加固設計與應用.pdf（48頁）

深亞微米CMOS電路對外部輻射現(xiàn)象很敏感，有可能導致軟錯誤的發(fā)生。因此，研究抗軟錯誤的電路設計具有實際意義。由宇宙中粒子輻射引起的軟錯誤通常有三類，包括單粒子翻轉SEUSINGLEEVENTUPSET，單粒子瞬態(tài)SETSINGLEEVENTTRANSIENT，單粒子閉鎖SELSINGLEEVENTLATCHUP。...

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鎖<em>存</em><em>器</em>、觸發(fā)<em>器</em>、寄存<em>器</em>和緩沖<em>器</em>的區(qū)別

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鎖存器、觸發(fā)器、寄存器和緩沖器的區(qū)別（8頁）

鎖存器、觸發(fā)器、寄存器和緩沖器的區(qū)別鎖存器、觸發(fā)器、寄存器和緩沖器的區(qū)別一、鎖存器一、鎖存器鎖存器（LATCH）對脈沖電平敏感，在時鐘脈沖的電平作用下改變狀態(tài)鎖存器是電平觸發(fā)的存儲單元，數(shù)據(jù)存儲的動作取決于輸入時鐘（或者使能）信號的電平值，僅當鎖存器處...

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第五章鎖<em>存</em><em>器</em>和觸發(fā)<em>器</em>

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第五章鎖存器和觸發(fā)器（7頁）

第五章鎖存器和觸發(fā)器第十五講教學內容①基本RS觸發(fā)器的構成及其工作原理；②時鐘控制觸發(fā)器的應用點及其工作原理；③主從觸發(fā)器和邊沿觸發(fā)器的構成及JK觸發(fā)器和D觸發(fā)器的應用。教學要求①掌握兩器件的工作原理；②熟悉兩器件的應用。教學難點①主從觸發(fā)器和邊沿觸發(fā)...

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三磁道磁卡讀存器的設計.pdf（74頁）

該系統(tǒng)是一款磁卡閱讀存儲器，根據(jù)用戶要求解決了普通閱讀器只能實時連接計算機，不能單獨使用的問題。而且針對作為特殊用途的磁卡，要求三道磁道都記錄數(shù)據(jù)，并且第三磁道記錄格式與標準規(guī)定的記錄格式不同時，系統(tǒng)配套的應用程序對其做了正確譯碼、顯示。整個系統(tǒng)...

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連<em>鎖</em>超級市場、便利店管理通用要求門店管理規(guī)範1範圍本標準對連<em>鎖</em>

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連鎖超級市場、便利店管理通用要求門店管理規(guī)範1範圍本標準對連鎖（3頁）

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基于脈沖鎖<em>存</em><em>器</em>的關鍵路徑優(yōu)化.pdf

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基于脈沖鎖存器的關鍵路徑優(yōu)化.pdf（79頁）

分類號TN47學號GS12062482UDC密級公開工程碩士學位論文基于脈沖鎖存器的關鍵路徑優(yōu)化基于脈沖鎖存器的關鍵路徑優(yōu)化碩士生姓名鄒浩波學科領域軟件工程研究方向高性能微處理器設計指導教師方糧教授劉祥遠副研究員劉必慰副研究員國防科學技術大學研究生院國防科學技術大...

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加盟遭棄連鎖業(yè)湧現(xiàn)直營浪潮（5頁）

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亂序處理器訪存行為建模.pdf（76頁）

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基于虛擬SPM的加速器訪存架構.pdf（90頁）

隨著處理器體系的發(fā)展，在通用多核處理器的結構上擴展加速核形成異構多核處理器平臺，已經成為了高性能計算的趨勢之一。在通用多核處理器上集成加速核，給處理核之間的互連方式的設計、多核平臺下的存儲層次的設計提出了新的挑戰(zhàn)。異構處理器平臺上互連方式與存儲層...

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眾核處理<em>器</em>的訪<em>存</em>優(yōu)化及分析.pdf

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眾核處理器的訪存優(yōu)化及分析.pdf（71頁）

長期以來，處理器和主存的性能分別按照不同的速度增長，達到一定的程度時，處理器的快速增長對系統(tǒng)性能的提升逐漸被慢速發(fā)展的主存所屏蔽，從而產生存儲墻問題。存儲墻問題嚴重制約著眾核處理器系統(tǒng)性能的提升。為了解決存儲墻問題，業(yè)界提出了很多方法技術，但是隨...

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處理器訪存部件功能驗證技術研究.pdf（79頁）

自從集成電路誕生以來，對于集成電路設計的驗證一直是集成電路設計的重要環(huán)節(jié)。到目前為止集成電路設計過程中對于驗證所投入的時間及人力已遠超過設計的投入，并且隨著設計復雜度的提高，驗證投入將進一步增加。本文以X微處理器訪存部件為驗證對象，從功能點提取、測...

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多核處理<em>器</em>共享級Cache訪<em>存</em>行為建模.pdf

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多核處理器共享級Cache訪存行為建模.pdf（74頁）

隨著電子信息技術的迅速發(fā)展，多核處理器在嵌入式設備上得到了廣泛的應用。在多核處理器層級的CACHE結構中，共享級CACHE作為影響處理器性能的重要一環(huán)，越來越受到學術界與工業(yè)界的重視。了解應用程序的共享級CACHE行為表現(xiàn)，不僅能夠為硬件人員共享級CACHE設計空間...

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基于訪存密度的內存控制器調度研究.pdf（61頁）

在CMP（CHIPMULTIPROCESS）系統(tǒng)中，內存系統(tǒng)被多個同時執(zhí)行的線程共享。在共享的內存系統(tǒng)中，一個線程的訪存請求不僅會被其它線程的請求延遲，而且也會破壞其它線程的訪存并行性。最終導致系統(tǒng)公平性和吞吐率下降，甚至有些線程會長期處于“饑餓”狀態(tài)。針對在CMP系...

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