基于FPGA的卷積神經(jīng)網(wǎng)絡加速器設計.pdf_第1頁
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文檔簡介

1、隨著計算機性能的不斷發(fā)展,以及對機器學習領域的深入研究,卷積神經(jīng)網(wǎng)絡(convolutional neural network,CNN)成為了近年以來最為熱門的機器學習算法之一。由于其復雜的網(wǎng)絡結構和訓練方法,卷積神經(jīng)網(wǎng)絡是極為耗費計算資源的一種算法。傳統(tǒng)的卷積神經(jīng)網(wǎng)絡是基于通用中央處理器(central processing unit,CPU)執(zhí)行計算的,這樣的計算不但緩慢低效,而且難以滿足實時性的計算要求。由于現(xiàn)場可編程門陣列(fi

2、eld-programmable gate array,F(xiàn)PGA)具有高度的并行性以及靈活性,能夠更好的承擔卷積神經(jīng)網(wǎng)絡的計算任務。本文基于 FPGA硬件提出了對卷積神經(jīng)網(wǎng)絡計算的加速方法,使用該方法對ETL9B手寫日本語數(shù)據(jù)庫進行了識別驗證,獲得了99.7%的識別正確率,同時減少了約90%的時間消耗。
  首先,本文第一章簡單介紹了卷積神經(jīng)網(wǎng)絡的基本概念以及應用背景。闡述了卷積神經(jīng)網(wǎng)絡算法的發(fā)展狀況,尤其是基于硬件的卷積神經(jīng)網(wǎng)絡

3、的現(xiàn)狀及不足,提出了基于硬件卷積神經(jīng)網(wǎng)絡加速器設計方案。
  其次,在第二章中本文詳細介紹了卷積神經(jīng)網(wǎng)絡的工作原理,包括圖像卷積,池化采樣,激活函數(shù)的計算以及反向傳播的訓練方法,文章還簡要介紹了幾種著名的卷積神經(jīng)網(wǎng)絡結構。
  再次,本文第三章詳細闡述了基于坐標旋轉數(shù)字計算方法(coordinate rotation digital computer,CORDIC)的激活函數(shù)計算原理,并且對傳統(tǒng)的CORDIC算法進行了優(yōu)化。

4、提出了一種基于查找表和貪心策略相結合的綜合旋轉策略(unified rotation strategy,URS),加快了傳統(tǒng)CORDIC算法的迭代收斂過程。
  第四章,詳細分析了基于FPGA的卷積神經(jīng)網(wǎng)絡硬件加速器的設計,完成了CORDIC處理器的設計,卷積核的設計,池化采樣模塊的設計,以及控制模塊的設計。
  最后,在第五章中給出了設計系統(tǒng)的仿真及測試結果,并且使用設計的系統(tǒng)對ETL9B手寫日本語數(shù)據(jù)庫進行了訓練,驗證了

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